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沈陽芯碩科技有限公司
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此總線連接 Cortex™-M0 內核的系統總線(外設總線)到總線矩陣，總線矩陣協調內核與外部總線的訪問。
1 存儲器和總線構架
1.1 系統構架
l 一個驅動單元
n Cortex™-M0 內核系統總線(S-bus)
l 四個被動單元
n 內部 SRAM
n 內部 Flash 閃存存儲器
n AHB 所連接的所有外設
n AHB 到 APB 的橋，它連接的所有 APB 設備
1.1.1 系統總線
此總線連接 Cortex™-M0 內核的系統總線(外設總線)到總線矩陣，總線矩陣協調內核與外部總線的訪問。
1.1.2 AHB/APB 橋(APB)
“AHB/APB 橋"在 AHB 和 APB 總線間提供同步連接。AHB 和 APB 的操作速度均與系統時鐘SYS_CLK 同步。
連接到每個橋的不同外設的地址映射請參考表 1-1。在每一次復位過程當中，除 SRAM 以外的所有外設都被關閉。
注意：對 AHB 或 APB 總線上的寄存器進行 8 位或者 16 位操作時，由于數據字節以小端格式存放在存儲器中，故有：
1. 讀操作：該操作會被自動轉換成 32 位的讀，對應的數據將按照小端格式被存儲在中間變量；
2. 寫操作：總線和橋會自動將 8 位或者 16 位的寫入數據擴展，并將缺失的高位補 0，以配合
32 位的向量。
1.2 存儲器組織
程序存儲器、數據存儲器、寄存器和輸入輸出端口被組織在同一個 4GB 的線性地址空間內。
數據字節以小端格式存放在存儲器中。一個字里的低地址字節被認為是該字的有效字節，而地址字節是有效字節。
1.3 嵌入式 SRAM
PT32x00x 內置2K 字節的 SRAM。它可以以字節、半字(16 位)或全字(32 位)訪問。SRAM 的起始地址是 0x2000 0000。
1.4 嵌入式 Flash 閃存
PT32x00x 內置的閃存存儲器可以用于在線編程(ICP)，在線編程(In-Circuit Programming–ICP)方式用于更新閃存存儲器的全部內容，它通過 SWD 協議或系統加載程序(Bootloader)下載
用戶應用程序到微控制器中。ICP 是一種快速有效的編程方法，消除了封裝和管座的困擾。
高性能的閃存模塊有以下的主要特性：
32K 字節的閃存存儲器結構，下面羅列存儲器的組成部分：
l 主程序區
l Bootloader 區
l 用戶配置區
通過片內閃存控制器 IFMC 可以便捷的控制 Flash 閃存，有關 IFMC 的詳細信息，請參考"16 片內閃存控制器(IFMC)"。
注意：PT32x00x 不支持中斷向量表重映射，故不支持 IAP 應用。
1.5 啟動配置
PT32x00x 支持兩種啟動模式：
l 從主程序區啟動
l 從 Bootloader 區啟動
這兩種啟動模式都基于 Flash 片內閃存，通過特定的程序配置以實現不同的啟動模式，而無需外部硬件的介入。
注意：默認從主程序區啟動，關于從 Bootloader 區啟動的詳細信息，請參考"16.3.6 系統啟動配置"
沈陽芯碩科技有限公司是澎湃微電子專業代理商，有技術問題可咨詢芯虎論壇。
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